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NPU板组件
NPU板接口如图2-16所示。
图2-16 NPU板接口
![]()
1 |
NPU2 M8 |
2 |
NPU2 M7/M10 |
3 |
NPU3 M8 |
4 |
NPU3 M7/M10 |
5 |
NPU4 M8 |
6 |
NPU4 M7/M10 |
7 |
NPU1 M8 |
8 |
NPU1 M7/M10 |
9 |
电源连接器 12V（J1040） |
10 |
电源连接器 GND（J1041） |
iBMC上显示每个NPU在主板上的物理位置，npu-smi工具显示NPU的逻辑位置，当NPU满配时，其对应关系如表2-13所示；当NPU半配时，其对应关系如表2-14所示。
表2-13 iBMC和npu-smi下的NPU编号对应关系（NPU满配）
编号 |
iBMC上显示 |
npu-smi下显示（NPU ID） |
|
|---|---|---|---|
1 |
NPU Board1(后视图左边的NPU板） |
NPU1 |
NPU3 |
2 |
NPU2 |
NPU2 |
|
3 |
NPU3 |
NPU1 |
|
4 |
NPU4 |
NPU0 |
|
5 |
NPU Board2(后视图右边的NPU板） |
NPU5 |
NPU7 |
6 |
NPU6 |
NPU6 |
|
7 |
NPU7 |
NPU5 |
|
8 |
NPU8 |
NPU4 |
|
表2-14 iBMC和npu-smi下的NPU编号对应关系（NPU半配）
编号 |
iBMC上显示 |
npu-smi下显示（NPU ID） |
|
|---|---|---|---|
1 |
NPU Board1(后视图左边的NPU板） |
NPU1 |
NPU3 |
2 |
NPU2 |
NPU2 |
|
3 |
NPU3 |
NPU1 |
|
4 |
NPU4 |
NPU0 |
|
- D芯片集成在NPU板上，不能单独更换。
- Atlas 800 训练服务器（型号 9010）支持配置1块或2块NPU板，每块NPU板提供4个NPU处理器。
- 0~7芯片的物理内存大小相同，由于Device OS占用了一部分3号和7号芯片内存，因此3号和7号芯片在npu-smi工具中显示的实际可用内存会小于其他芯片。
